A15架构的处理器性能有多强？比A9架构强多少？
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在同等条件下，前者的计算能力是后者的150%-200%。
a15比a14强多少？
现在不比a14高多少。
相比之下，GeekBench数据库显示，A14仿生CPU单核最高得分为1606，多核最高得分为4305。
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这样，与A14的仿生性能相比，A15的仿生性能并没有提升多少，甚至可以忽略不计。
据悉，A15仿生跑分之所以这么低，是因为芯片还处于测试阶段，加上后期的优化，性能可以达到理想水平。
除了CPU运行外，A15仿生GPU性能也被曝光。
@FrontTron表示，A15仿生芯片的功耗为8.5W，而A14仿生芯片仅为7W。
因此，A15仿生学需要进一步优化。
ARM Cortex-A15的性能
据估计，Cortex-A15 MPCore处理器的移动配置可以提供当前高端智能手机5倍以上的性能，以及基于ARM处理器的基础架构平台总性能的十倍以上。同时，它还具有ARM标志性的低功耗特性。
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以下列出了的预期特定应用实现示例：智能手机和移动计算：1 GHz-1.5 GHz单核和双核配置设备特性：灵活的性能：即时Web浏览、高带宽操作、改进的媒体和浮点性能；最佳功耗：扩展的低功耗范围和延长的电池寿命；更丰富的体验：控制台级游戏、导航、增强现实应用数字家庭娱乐使用范围：1 GHz-2 GHz双核或四核配置设备特点：高端性能：一般和媒体性能密集型流媒体、图形和计算工作负载。
最佳功耗和散热：无风扇运行，更大的energyStar物理内存：家庭服务器和Web 2.0服务器的附加内存大于4GB使用范围：1.5GHz-2.5 GHz四核配置设备特点：高性能：高端高效单线程和MP高扩展性：SoC一致性，保证高性能和高能效。
虚拟化支持：支持高效虚拟机和访问4GB以上物理内存无线基础架构使用情况：1.5GHz-2.5 GHz四核、八核或更高配置设备特点：性能：高端整数和浮点数性能可扩展性：“大集成”4核。
更低的总拥有成本。
大型内存设备：最高支持1TB，硬件虚拟化支持可靠性：纠错、软故障恢复、设备完整性监控Cortex-A15 MPCore架构ARMv7-A Cortex多核单处理器集群通过AMBA 4技术实现多个一致的SMP处理器集群ISA支持arm thumb-2 trustzone安全技术NEON高级SIMDDSP SIMD。扩展VFPv4浮点Jazelle RCT硬件虚拟化支持大物理地址扩展(LPAE)内存管理ARMv7内存管理单元调试和跟踪coresight dk-a15 cortex-a15 mpcore主功能Thumb-2技术可以为传统ARM代码提供最高的性能，最多可以节省30%存储指令占用的内存。
TrustZone技术保证了安全应用的可靠实现，适用于从数字版权管理到电子支付的各种应用。
在技术和行业合作伙伴的广泛支持下，NEON NEON技术可以加速多媒体和信号处理算法(如视频编码/解码、2D/3D图形、游戏、音频和语音处理、图像处理技术、电话和声音合成)。数字信号处理器SIMD扩展提高了ARM解决方案在高性能应用中的数字信号处理器处理能力，同时通过便携式电池供电设备提供所需的低功耗。
DSP扩展针对广泛的软件应用进行了优化，包括伺服电机控制、VoIP以及视频和音频编解码器。
浮点为半精度、单精度和双精度浮点算法中的浮点运算提供硬件支持。
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Cortex-A15处理器的浮点功能增强了下一代消费产品(如互联网设备、机顶盒和家庭网关)中使用的浮点算法的性能。
Jazelle RCT可以将即时生产(JIT)和预编译字节码语言的代码大小减少多达3倍，从而提高传统虚拟机的速度。硬件虚拟化Cortex-A15 MPCore处理器是首款为数据管理和仲裁提供高效硬件支持的ARM处理器。这样，多个软件环境及其应用程序可以同时访问系统功能。
这样，实现了具有相互隔离的虚拟环境的可靠设备。
大型物理地址扩展(LPAE)LPAE的引入允许处理器访问高达1TB的内存。
优化的1级缓存性能和功耗优化的l 1缓存与最低访问延迟技术相结合，可以最大限度地提高性能并降低功耗。
在缓存中，32KB用于指令，32KB用于数据。
它还提供了增强处理器间通信或支持丰富的SMP功能操作系统以实现缓存一致性的选项，从而简化多核软件的开发和集成。在高频设计或需要降低与片外存储器访问相关的功耗的设计中，它可以为高达4 MB的高速缓冲存储器提供低延迟、高带宽访问可靠性和软故障恢复。Cortex-A15处理器中的所有RAM(包括L1和L2缓存)都受到奇偶校验和ECC纠错功能的保护。
该机制可以纠正单比特错误、检测双比特错误和记录错误。
ECC支持不会影响常见情况(无错误)AMBA 4高速缓存一致性互连(CCI) CCI提供AMBA 4 AXI一致性扩展(ACE)兼容端口，以实现多个Cortex-A15 MPCore处理器之间的完全一致性，这可以更好地利用高速缓存并简化软件开发。
此功能对于高带宽应用程序是必要的，包括需要单核和多核处理器一致集群的游戏、服务器和网络。
结合CCI Corelink网络互联和内存控制器IP，提高了系统性能和能效。
Cortex-A15 NEON媒体处理引擎(MPE) Cortex-A15 MPE提供的引擎可以同时提供Cortex-A15浮点单元的性能和功能，以及NEON高级SIMD指令集的实现，从而进一步提高媒体和信号处理功能的速度。
MPE扩展了Cortex-A15处理器的浮点单元(FPU)，以提供四通道媒体访问控制和额外的64位和128位寄存器集，并支持基于每个周期8位、16位和32位整数和32位浮点数据的丰富的SIMD运算集。
Cortex-A15浮点单元(FPU) FPU提供与ARM VFPv4架构兼容的高性能单、双精度浮点指令，是与上一代ARM浮点协处理器软件兼容的。
先进的多核功能该处理器还利用了被广泛认可的ARM MPCore多核技术，支持性能可扩展性，能够控制功耗，超越了如今同类高性能设备的性能，同时在严格限制移动电源的情况下也能保持运行。
多核处理功能为任意四个组件处理器提供不使用时关闭的功能，例如，在设备处于待机模式时关闭以节省功耗。
当需要更高的性能时，将利用所有处理器来满足需求，同时仍然分担工作负载以保持尽可能低的功耗。
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检测控制单元SCU负责管理处理器的互连、仲裁、通信、高速缓存之间的传输以及系统存储器传输、高速缓存一致性和其他功能。
Cortex-A15 MPCore处理器还将这些功能暴露给其他系统加速器和无缓存DMA驱动的外设，以提高性能并降低系统范围内的功耗。
这种系统一致性还可以降低维护各种操作系统驱动程序之间的软件一致性所涉及的软件复杂性。
加速器端口SCU上兼容amba4aaxi的辅助接口为主机提供了一个互连点，使得直接连接Cortex-A15处理器变得更加容易。
该接口支持所有标准读写事务，没有其他一致性要求。
然而，对于一致存储区域的任何读事务都将与SCU交互，以测试信息是否已经存储在L1高速缓存中。
SCU将强制写入的数据在转发到内存系统之前保持一致性，并可能将事务分配给L2缓存，从而消除直接写入对片外内存的功耗和性能影响。通用中断控制器实现标准化、基于架构的中断控制器后，GIC可以提供丰富灵活的方式中断处理器间通信，路由系统中断并确定其优先级。
在软件的控制下，它可以支持多达224个独立的中断，每个中断可以分布在CPU之间。优先级由硬件决定，然后在操作系统和信任区软件管理层之间路由。
在虚拟机管理程序的帮助下，这种路由灵活性和支持虚拟化操作系统中断的特性提供了增强解决方案功能所需的主要功能之一。
Cortex-A15 MPCore处理器集成了各种ARM技术并得到其支持，包括系统IP、物理IP和开发工具。
该技术辅以ARM Connected Community提供的各种SoC和软件设计解决方案、工具和服务，为ARM合作伙伴提供了涵盖全功能开发、验证和生产的渠道，增加了设备的吸引力，显著缩短了上市时间。